การออกแบบบัสระบบสำหรับวงจรอสมวาร

สุฟียัน สูเด็ง

Please use this identifier to cite or link to this item: https://cuir.car.chula.ac.th/handle/123456789/13578

Full metadata record

DC Field	Value	Language
dc.contributor.advisor	อาทิตย์ ทองทักษ์	-
dc.contributor.author	สุฟียัน สูเด็ง	-
dc.contributor.other	จุฬาลงกรณ์มหาวิทยาลัย. คณะวิศวกรรมศาสตร์	-
dc.date.accessioned	2010-10-04T02:43:19Z	-
dc.date.available	2010-10-04T02:43:19Z	-
dc.date.issued	2549	-
dc.identifier.uri	http://cuir.car.chula.ac.th/handle/123456789/13578	-
dc.description	วิทยานิพนธ์ (วศ.ม.)--จุฬาลงกรณ์มหาวิทยาลัย, 2549	en
dc.description.abstract	นำเสนอการออกแบบบัสระบบเพื่อเป็นต้นแบบสำหรับวงจรอสมวารประกอบด้วย การออกแบบบัส อินเตอร์รัพท์ ดีเอ็มเอ และนำเสนอการเชื่อมต่อระหว่างวงจรสมวารและอสมวาร ระบบที่ออกแบบประกอบด้วยไมโครโพรเซสเซอร์แบบอสมวาร ที่ดัดแปลงในส่วน คำสั่ง โครงสร้าง และส่วนควบคุม ระบบบัสแบบอสมวาร ดีเอ็มเอ ซึ่งออกแบบเป็นวงจรสมวารและอสมวาร ส่วนควบคุมอินพุต/เอาท์พุต สำหรับควบคุมการรับส่งข้อมูลของอินพุต/เอาท์พุตแบบสมวาร บัสแบบอสมวารออกแบบโดยแบ่งออกเป็น 6 ส่วน ประกอบด้วย ส่วนเชื่อมต่อบัส ตัวขับบัส สายสัญญาณบัส ตัวควบคุมบัส ตัวรับบัส และส่วนเชื่อมต่อวงจรสมวาร ส่วนเชื่อมต่อบัส ออกแบบสำหรับเชื่อมต่อระหว่างบัส ไมโครโพรเซสเซอร์ และดีเอ็มเอ ตัวขับบัส ออกแบบให้ทำงานในลักษณะสวิทซ์ที่ใช้ในการเปิดปิดสัญญาณเข้าสู่บัส เกตผกผัน ต่อกับสายสัญญาณบัสเพื่อให้บัสใช้กับวงจรอสมวารได้ ตัวรับบัส ใช้เพื่อรับสัญญาณจากบัสและส่งต่อไปยังปลายทาง ตัวควบคุมบัสออกแบบโดยใช้กราฟบรรยายการเปลี่ยนสัญญาณ ใช้ในการควบคุมการทำงานของบัส ดีเอ็มเอ ออกแบบเป็นทั้งวงจรสมวาร และวงจรอสมวาร ดีเอ็มเอแบบอสมวารออกแบบโดยใช้เครื่องจักรสถานะ ส่วนดีเอ็มเอแบบอสมวาร ออกแบบโดยใช้การเข้ารหัสแบบโครงสร้าง ส่วนควบคุมอินพุต/เอาท์พุต ออกแบบเพื่อควบคุมการติดต่อกับอินพุต/เอาท์พุตส่วนที่เป็นวงจรสมวารทุกชนิด เช่น จอแสดงผล แป้นพิมพ์ ปุ่มต่างๆ เป็นต้น วงจรที่ออกแบบทดสอบโดยการจำลองการทำงาน เมื่อได้การทำงานที่ถูกต้องแล้ว จึงนำมาทดสอบการทำงานจริงกับบอร์ดทดลองของบริษัท Xilinx โดยใช้ เอฟพีจีเอ เบอร์ 3S500EFG320 ในการอิมพลีเมนท์จะกำหนดพาติชั่นเพื่อป้องกันไม่ให้ส่วนของวงจรเกิดการเชื่อมสายที่ผิดพลาด หลังจากมีการปรับปรุงวงจรในภายหลัง จากการทดสอบปรากฏว่า วงจรทำงานได้อย่างถูกต้องและใช้เกตจำนวน 141,063 เกต สำหรับวงจรที่ออกแบบรวมกับดีเอ็มเอแบบอสมวาร และ 141,587 เกต สำหรับวงจรที่ออกแบบรวมกับดีเอ็มเอแบบสมวาร	en
dc.description.abstractalternative	To propose a system bus design for asynchronous circuits. Interrupt technique and DMA method are included in the design for bus. Moreover, an interfacing between synchronous and asynchronous circuits with I/O capability is also shown, our proposed system composes of a reference asynchronous processor, which instruction, architecture and control unit have been modified. The asynchronous system bus, DMA controller, both synchronous and asynchronous circuits and the I/O controller are demonstrated. The bus structure is divided into six components: Bus Interface, Bus Driver, Bus lines, Bus Controller, Bus Receiver, and Synchronous Interface. Bus interface is designed to interface with an asynchronous processor. Bus Driver acts like an on/off switch to enable/disable transition signal on the bus. The weak inverters are added on each bus line to remove high impedance. Bus receiver receives data from bus and transfers to the destination. Bus controller is designed with STG to control the bus synchronization. Two versions of DMA controller are introduced: synchronous and asynchronous. The state machine model is used for a synchronous version, while structural encoded STG is implemented for an asynchronous version. I/O controller is responsible for arbitrating between two or more I/O modules such as the display, the keyboard and other inputs. The proposed design has been implemented on Spartan-3E FPGA no. 3S500EFG320 by partitioning each module in order to prevent place and routing conflict. Finally, time simulation and board demonstration are shown. The design consumes 141,063 gates for system with asynchronous DMA controller and 141,587 gates count for system with synchronous DMA controller.	en
dc.format.extent	3535598 bytes	-
dc.format.mimetype	application/pdf	-
dc.language.iso	th	es
dc.publisher	จุฬาลงกรณ์มหาวิทยาลัย	en
dc.relation.uri	http://doi.org/10.14457/CU.the.2006.1183	-
dc.rights	จุฬาลงกรณ์มหาวิทยาลัย	en
dc.subject	ดิจิตอลอิเล็กทรอนิกส์	en
dc.subject	วงจรอะซิงโครนัส	en
dc.subject	ไมโครคอมพิวเตอร์ -- ระบบบัส	en
dc.title	การออกแบบบัสระบบสำหรับวงจรอสมวาร	en
dc.title.alternative	A design of system bus for asynchronous circuits	en
dc.type	Thesis	es
dc.degree.name	วิศวกรรมศาสตรมหาบัณฑิต	es
dc.degree.level	ปริญญาโท	es
dc.degree.discipline	วิศวกรรมคอมพิวเตอร์	es
dc.degree.grantor	จุฬาลงกรณ์มหาวิทยาลัย	en
dc.email.advisor	arthit@cp.eng.chula.ac.th,Arthit.T@Chula.ac.th	-
dc.identifier.DOI	10.14457/CU.the.2006.1183	-
Appears in Collections:	Eng - Theses

Files in This Item:

File	Description	Size	Format
Sufian_Su.pdf		3.45 MB	Adobe PDF	View/Open

Show simple item record